不能够把时序图看的非常透彻,然后把时序图写成Verilog代码,有时候甚至搞不清楚信号之间的时序关系。 相关文章: 2021-08-15 2022-12-23 2022-01-11 2021-09-29 2022-01-11 2022-12-23 2022-12-23 2021-06-23