现象

在vivado2018.3下生成了RAM IP,丢到modelsim中仿真发现doutb输出均为0。调整AB端口的时钟速率,发现低于5ns不行,输出为0。但5ns以上正常。

解决方法

比对了vivado自带的仿真和modelsim的仿真,时钟设置过小的时候,结果均为0。排除软件问题。

*延长RAM空闲时间,之后才去操作,避免内部还没有初始化完成就去操作。真是老了,犯这个错误,哈哈。

modelsim仿真xilinx ram输出均为0

以上

相关文章:

  • 2021-05-14
  • 2021-07-02
  • 2022-01-05
  • 2022-12-23
  • 2022-12-23
  • 2022-12-23
猜你喜欢
  • 2021-04-17
  • 2022-12-23
  • 2022-12-23
  • 2022-12-23
  • 2022-12-23
  • 2021-09-07
  • 2022-12-23
相关资源
相似解决方案