quartus新建工程时，top_level entity需要和顶层模块名保持一致。
不然会报错。
可以在下图中单项双击选中进行分析，比如切换到RTL Viewer中，可以看到
在RTL Viewer中选中可以在location node中选择chip planner中看到fpga中的具体连线。（需要先进行再布局布线(Fitter)）
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